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用户61645732
5个月前发布
66次阅读
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私信
请问有谁知道盘古100pro的ip核文件在哪可以拿到吗？
我在网站资料获取相关资料里面找了半天也没有，那个官方的100pro相关文件里面也没看见ip核文件，求告知，ddr3的ip没安装，急晕了
FPGA初学者园地
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damihuang
5个月前发布
34次阅读
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私信
LVDS的IP哪里可以下载？
要使用PG2L50H解串Serial LVDS输出的ADC3562，需要LVDS IP，哪位大神有?
FPGA高级设计
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Eee111777
5个月前发布
31次阅读
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私信
PDS报错
E: Place-0084: IO_CLOCK: the driver u_ddr3_test_h/u_ipsxb_ddrphy_pll_0/u_pll_e3/goppll fixed at PLL_158_179 is unreasonable. Sub-optimal placement for a clock source and a clock buffer.这个报错该怎么解决
FPGA初学者园地
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Eee111777
5个月前发布
33次阅读
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私信
时钟管脚约束
想问一下为什么盘古50K的差分时钟约束不了，无法设置成A10和B10，差分时钟该怎么约束
FPGA初学者园地
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用户99984988
5个月前发布
29次阅读
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私信
远程实验室
求问，远程实验室的fpga芯片是什么，pds创建的相关设置需要注意什么
FPGA初学者园地
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用户99984988
5个月前发布
49次阅读
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私信
提问
远程实验室
关于远程实验室开发箱引脚的资料，哪里能找全，在训练大厅下的不全
FPGA初学者园地
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lllshmrrrr
5个月前发布
94次阅读
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私信
提问
盘古50K IP核在哪里找
盘古50K的DDRIP核在哪里可以找到呀，配套资料里没有看到呢，只在盘古100里看到了一个，应该不能通用吧
FPGA初学者园地
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Chuan Ouyang
5个月前发布
37次阅读
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私信
提问
DDR仿真ddr_init_done不拉高
ModelSim
ddr仿真 ddr_init_done一直不拉高是为啥，有仿真成功的吗，想请教请教大佬们，仿真时间我觉得已经很久了。有相关经验的佬可以评...
项目协作与反馈
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用户12529378
5个月前发布
81次阅读
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私信
提问
大佬们，求解答
大佬们，使用官方程序时，调试的时候ip的地址跟代码内（文档）设置不一样
FPGA在通信中的应用
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cyj
5个月前发布
28次阅读
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私信
提问
请问这个技术文档有模板吗，在哪里找呀
项目协作与反馈
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用户70227953
5个月前发布
47次阅读
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私信
提问
在运行紫光同创资料例程demo的时候报这样的错是哪里出了问题？应该怎么解决？（已尝试用大模型改）
C: Flow-2001: Design file missing: "D:/Q/2_Demo/3_2_HDMI_IN_DDR3_YCbCr/3_2_HDMI_IN_DDR3_YCbCr/HDMI_IN_DDR3_YCbCr/source/rtl/fram_buf.v". C: Flow-2001: Design file missing: "D:/Q/2_Demo/3_2_HDMI_IN_DDR3_YCbCr/3_2_HDMI_IN_DDR3_YCbCr/HDMI_IN_D...
FPGA初学者园地
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hrj051219
4个月前发布
28次阅读
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私信
重偿求，用以太网怎么传输双目的摄像头模块！！！以及文档提模版！有偿！
FPGA初学者园地
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KTXYPTC111
3个月前发布
15次阅读
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私信
如何调用carry进位链
如何调用carry进位链
项目协作与反馈
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greg
3个月前发布
51次阅读
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私信
提问
远程升级中应用位流开关无效
按照Logos系列FPGA配置用户指南中的远程升级位流方式，芯片是PGL50G，如果人为将同步字擦除，重新上电后无法跳转到黄金位流，还...
FPGA初学者园地
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用户65985800
3个月前发布
92次阅读
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私信
提问
关于远程平台上的问题
PG2L100H
你好，我在远程平台上测试 UART，逻辑分析仪能看到 FPGA 的 TX 引脚有波形，但 LabSerial 收不到数据。烧了官方的 uart_test 例程也收不到，请问是什么原因？是不是串口通道需要额外配置？
FPGA初学者园地
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用户47856855
3个月前发布
18次阅读
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私信
compile卡在saving to db
有没有大佬懂pdscompile时为什么卡在是saving to db？
FPGA初学者园地
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用户81913081
3个月前发布
31次阅读
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私信
小眼睛企业赛题
朋友们，CoreMark性能跑分验证怎么做呀？让参考CoreMark移植指南，但是没找到这个指南呢
FPGA初学者园地
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用户60137887
2个月前发布
28次阅读
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私信
提问
debug显示一直处于复位状态
JTAG
程序可以下载进去，但是调试时debug显示一直处于复位状态，有可能是什么原因
FPGA初学者园地
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YYoo
2个月前发布
45次阅读
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私信
提问
新手：pds里的顶层文件怎么修改成红线上的sparrow_soc.v呢
转换
是职业赛道里的源文件导入后平台就自动设置那个顶层文件了
FPGA初学者园地
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王zihan
1个月前发布
17次阅读
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私信
请大神指点
请问HDMI子卡的视频流输入端接到1280*720，刷新频率是180hz的电脑上，然后子卡最高接受30帧率，这样会有影响吗
FPGA初学者园地
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