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爪云
6个月前更新
29次阅读
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私信
求助
想改ms7200芯片的接收画质,但是网上找到的手册没有寄存器配置。各位大佬有资源吗
FPGA初学者园地
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用户36277823
5个月前更新
71次阅读
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私信
rk3568 n1开发板有官方配置好的乌班图系统吗 没有找到
ARM基础入门
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用户36277823
5个月前发布
40次阅读
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私信
rk3568 n1开发板有官方配置好的乌班图系统吗 没有找到
ARM开发板评测
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用户26036968
5个月前发布
65次阅读
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私信
PG2L100H+RK3568系统时钟问题
PG2L100H
大家有没有遇到这个问题:系统时钟信号赋值给LED,LED不亮,引脚约束如图。会不会是晶振坏了还是其他原因啊?板子是PG2L100H+RK3...
FPGA初学者园地
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puffyoll
5个月前发布
48次阅读
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私信
各位大佬,这是因为是什么(RK3568 N1板),为什么只能发现MASKROM设备,不能发现LOADER设备呢
项目协作与反馈
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peterdeng
5个月前发布
42次阅读
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私信
???
怎么一烧录就重启电脑 之前烧流水灯都可以 现在烧HDMI后流水灯也直接重启
FPGA初学者园地
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111666111jjj
5个月前发布
163次阅读
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私信
紫光赛道如果测评失败是不是板子押金和那个比赛的报名费都退啊
如果测评失败是不是板子押金和那个比赛的报名费都退
FPGA初学者园地
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用户48678799
5个月前发布
39次阅读
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私信
提问
配置mac的时候为什么没有对应的文件?
t,mac的值应该对应一个lic文件的文件名,但下载的pds里根本没有这个文件,要怎么办?
FPGA初学者园地
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用户75784469
5个月前发布
58次阅读
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私信
求助
求各位大佬,原理图该在哪里找到
FPGA初学者园地
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小眼睛FPGA
5个月前发布
447次阅读
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私信
【通知】2026集创赛紫光同创企业命题初赛能力测试入口现已开放!请按时完成!!!
【通知】2026集创赛紫光同创企业命题初赛能力测试入口现已开放,请各组队伍按时参加
各位同学:平台现已开放本次能力测试入口,...
FPGA初学者园地
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用户42929191
5个月前发布
30次阅读
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私信
提问
远程硬件平台一直被强制释放是什么原因。
FPGA初学者园地
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鸟嘌呤
5个月前发布
43次阅读
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私信
在盘古50与rk3568进行通信时遇到的问题
在rk端始终编译不了.ko是什么原因?(已经adb push了自己的rk端的源码)
FPGA初学者园地
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国家特级不保护废物
5个月前更新
1091次阅读
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私信
昇腾边缘 AI 实战:从 WSL 交叉环境搭建到 YOLOv26-Pose OM 模型转换
📝 前言与场景
在昇腾边缘计算(如 Atlas 200I DK A2 / Orange Pi AI Pro)的开发中,我们通常采用**“PC 端交叉编译与模型转换...
+1
硬件加速与算力
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国家特级不保护废物
5个月前更新
268次阅读
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私信
昇腾边缘AI实战: xxd 模型硬编码与极速部署
📝 前言与场景
在昇腾边缘计算板(如基于 Ascend 310B4 的开发板)上部署 AI 应用时,常规做法是使用 aclmdlLoadFromFile 接口从...
AI算法与模型
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用户25304915
5个月前发布
91次阅读
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私信
提问
提供的以太网实验例子中为何rgmii发送模块要使用接受的时钟?
聽 聽 GTP_OSERDES #(
聽 聽 聽.OSERDES_MODE("ODDR"), 聽//"ODDR","OMDDR","OGSER4","OMSER4","OGSER7","OGSER8",OMSER8"
聽 聽 聽.WL_EXTEND 聽 ("FALSE"), 聽 聽 //"TRUE"; "FALSE"
聽 聽 聽.GRS_EN 聽 聽 聽("TRUE"), 聽 聽 聽 聽 //"TRUE"; "FALSE"
项目协作与反馈
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clll
5个月前发布
40次阅读
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私信
求告知,这种要怎么办啊,可以不仿真吗
PG2L100H
FPGA初学者园地
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用户16374284
5个月前发布
86次阅读
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私信
求助!盘古50K,flash烧录
有没有大佬知道盘古50k怎么烧录到flash里面,我不太明白,求大佬帮助!
FPGA初学者园地
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Az147139111
5个月前发布
21次阅读
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私信
求助!!!
本人第一次打集创赛,目前为止,没有任何思路与头绪,求各位大佬指点一下,我该如何入手
FPGA初学者园地
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yfl118
5个月前发布
26次阅读
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私信
求救
跑例程仿真遇到了成吨的报错,有uu知道为什么吗
FPGA初学者园地
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dddhhhh
5个月前发布
37次阅读
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私信
小麻雀软核问题求助
PG2L100H
小麻雀riscv软核使用ICB总线,无法读取DDR的数据,官方有提供icb转AXI总线的模块吗,不然ram存放不了多少数据,存进DDR又无法读取。
FPGA初学者园地
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