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FPGA
FPGA初学者园地
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为FPGA新手提供学习资源,包括语言基础、开发工具使用和简单实验,快速上手。
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热门
精华
用户16374284
23天前发布
47次阅读
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私信
求大佬帮忙看看哪里出问题了!
昨天还可以烧录调试的,今天中午就检测不到了,重新断电,关软件,上电,试了好多次都是这样,昨天好像烧录调试的过程中突然就显...
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3
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小眼睛FPGA
2个月前更新
214次阅读
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私信
提问
【开发板常见问题】关于PDS软件的安装问题
先确认软件版本和license是否匹配,用错会有“Failure”报错;license必须先设置虚拟网卡的MAC设置,再用license,如失败请确认下是否设置了虚拟网卡的MAC设置,文件夹里有对应的操作步骤,其他的流程还是按原来文档的不用改,.lic文件也不用动,用修改的虚拟...
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7渺兮余怀
28天前发布
33次阅读
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私信
紫光同创盘古100pro+
请问这种情况该怎么解决
5
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030
24天前更新
51次阅读
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私信
提问
synthesize阶段报这些错该怎么解决
基本上是40pin扩展口的引脚报的错,还有一些电平错误,按照原理图设置3.3v为什么报错?
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用户25304915
24天前发布
82次阅读
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私信
已解决
请教一下各位,下载器上的下载口是7pin怎么连接到5pin的板子接口上,我用了那个转接器,但是两头连不上
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张坤琦
26天前发布
110次阅读
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私信
提问
求助:我的是盘古50H开发板,不管是我自己写的程序,还是官方例程,下载之后,板子上的led都是常亮,其他的一点反应都没有。
5
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yoooooung
26天前发布
41次阅读
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私信
提问
求助求助
在加了管脚约束之后进行布局布线,然后报了这样的错误,E: Place-0084: GLOBAL_CLOCK: the driver key_mode_ibuf/opit_1 fixed at IOLHR_16_1296 is unreasonable. Sub-optimal placement for a clock source and a clock buffer.请问是为什么
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Datou21
25天前发布
40次阅读
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私信
提问
编译找不到vh文件
请问工程里明明有vh文件,也设置了vh文件的类型位Verilog Header,为什么报错说没有找到vh文件
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D3eeee
26天前发布
61次阅读
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私信
提问
求助:为何PG2L100Hpro+开发板插上电源后打开开关板上的power指示灯不亮?
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用户25638240
27天前发布
29次阅读
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私信
自己写了一个流水灯放在200H上为什么出现了5个用户灯全亮的情况
我这边只绑定了四个管脚但是5个用户灯出现了全亮的情况?这种情况该怎么解决
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xixixi
28天前发布
28次阅读
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私信
modelsim与PDS联合报错
ModelSim
一直显示
Error loading design
# Error:Error loading design
Pausing macro execution
5
2
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小眼睛FPGA
2个月前更新
159次阅读
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私信
提问
【开发板常见问题】7K板卡扫描不到驱动问题
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D3eeee
31天前发布
42次阅读
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私信
已解决
求助:为什么有了top.v文件了,flow中还是没有compile选项?
如图,没有compile,也无法综合呀
2
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D3eeee
31天前更新
41次阅读
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私信
已解决
请问并口驱动程序安装失败怎么解决?
以管理员身份运行了也还是这样
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ffffff
1个月前发布
77次阅读
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私信
提问
例程下载后没有用
除了屏幕是自己的,其它全是官方的配件,盘古50k的ov5640双目输入,hdmi输出,一开始显示器没有信号,莫名其妙的成功过一次(当时反复下载都没有问题),后来隔两天又不能使了
6
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Turing丶
1个月前发布
48次阅读
关注
私信
提问
求助:核心板上的DDR3地址线与数据线连接问题!
板子型号为PL200H与100H:针对这两个型号的核心板来说提供的资料当中并没有核心板原理图,想要知道核心板的ddr是都是各自拥有完...
1
3
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辣子鸡
1个月前发布
30次阅读
关注
私信
PDS检测不到pg676
另一块pg2l50h板子就可以检测到,求求求求求求,为什么会有这样。。。。。。
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2
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Turing丶
1个月前发布
29次阅读
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私信
提问
关于DDR读写例程中控制器wr_ctrl中axi_awsize大小的疑问
`timescale 1ns / 1ps//////////////////////////////////////////////////////////////////////////////////// Company: Meyesemi// Engineer: Nill// // Create Date: 07/01/23 17:29:04// Design Name: // Module Name: wr_ctrl// Project Name: // Target...
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米虫大人
2个月前发布
35次阅读
关注
私信
PG1K开发板使用问题
PG1K开发板使用问题
在测试PG1K的led_light例程时,输入时钟是40MHz,通过IP核工具添加PLL,相关参数设置如下:
Generate编译成...
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小眼睛FPGA
2个月前发布
63次阅读
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私信
【干货】基于串口的FPGA远程升级
近期,我们收到许多粉丝朋友的技术问题反馈,为便于大家的学习,小编整理了一系列常见问题的技术指南,将陆续分期发布,请大家敬...
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