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3个月前发布87次阅读

求助，pango100pro+，移植软核

请问一下，我们在移植RISC-V软核的时候，根据pango100pro+的硬件手册来设置的时钟分别为27MHZ和125MHz（之前两个时钟都设置的是5...

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2个月前发布85次阅读

提问盘古50k烧录问题

盘古50看一烧录就出现这样，求求哪位大哥指教一下

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4个月前更新83次阅读

提问扫描设备过程中重启应该怎么解决

在点击file-scan device后，电脑会报错，然后重启，这种应该怎么解决qwq

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3个月前更新83次阅读

提问在盘古50上配置ddr3与pcie ip时的问题

紫光-1.png
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png文件
464.9K 如图所示，配置ip并生成后编译没问题，但在工程中报错（Syntax Error Files)，ipsxb_rst_...

在盘古50上配置ddr3与pcie ip时的问题-逻辑矩阵技术社区

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5个月前更新82次阅读

【技术分享贴】FPGA的Jtag接口烧了，怎么办？

JTAG 接口的输入引脚通常设计为高阻抗，这使得它们对静电电荷积累非常敏感，由于JTAG 接口需要频繁连接调试器、下载...

【技术分享贴】FPGA的Jtag接口烧了，怎么办？-逻辑矩阵技术社区

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5个月前发布79次阅读

提问【开发板常见问题】烧录扫描外部flash识别成未知器件（0xb4018）

开发板采用芯天下的XT25BF128FSSIGU-W，需用户手动添加flash器件，操作参考开发板资料的《05_FPGA&CPLD的下载与固化.pdf》文档，不用管是不是在厂商列表，随便选一个，然后id复制上去添加就行了

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3个月前发布75次阅读

提问求助：为何PG2L100Hpro+开发板插上电源后打开开关板上的power指示灯不亮？

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8个月前发布67次阅读

提问做了一年FPGA逻辑开发，技术成长遇到瓶颈，求指点方向

楼主本科毕业，在一家小公司做FPGA开发快一年了。日常工作主要是根据协议（比如UART, SPI, I2C）写写接口，或者把算法工程师的Matlab代码用Verilog实现。现在感觉很迷茫：感觉技能栈很窄，除了Verilog和Vivado，其他的了解不多。做的项目技术含量不高，感觉换...

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4个月前发布67次阅读

提问求助：核心板上的DDR3地址线与数据线连接问题！

板子型号为PL200H与100H：针对这两个型号的核心板来说提供的资料当中并没有核心板原理图，想要知道核心板的ddr是都是各自拥有完...

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3个月前更新66次阅读

提问synthesize阶段报这些错该怎么解决

基本上是40pin扩展口的引脚报的错，还有一些电平错误，按照原理图设置3.3v为什么报错？

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3个月前发布66次阅读

远程实验室

请问有远程实验室的约束文件吗

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3个月前发布66次阅读

远程实验室

远程实验室有没有现成的约束，已经调试好几天了

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2个月前发布64次阅读

提问提供的以太网实验例子中为何rgmii发送模块要使用接受的时钟？

聽聽 GTP_OSERDES #(
聽聽聽.OSERDES_MODE("ODDR"), 聽//"ODDR","OMDDR","OGSER4","OMSER4","OGSER7","OGSER8",OMSER8"
聽聽聽.WL_EXTEND 聽 ("FALSE"), 聽聽 //"TRUE"; "FALSE"
聽聽聽.GRS_EN 聽聽聽("TRUE"), 聽聽聽聽 //"TRUE"; "FALSE"

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5个月前发布63次阅读

提问【开发板常见问题】HDMI环路例程显示问题排查思路

HDMI环路例程显示问题排查思路：
显示器是否使用VGA转接头，转接头不支持
HDMI输入接口连接信号源后再启动程序配置HDMI芯片
MS7200和MS7210是否配置成功（led_int）

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3个月前更新63次阅读

盘古50K关于DDR3的IO管脚约束问题

参照DDR3 IP核对mem_dqs管脚进行约束，使用SSTL15D_I电平，但是系统出现报错：
E: ConstraintEditor-0007: [E:/Pango Project/ov...

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5个月前发布62次阅读

【技术篇】MESH自组网无线应用方案

MESH技术简介
Mesh无线自组网系统是采用全新的“无线网格网”理念设计的移动宽带多媒体通信系统。系统所有节点在非视距、快速移...

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FPGA在通信中的应用

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3个月前发布62次阅读

提问求助求助

在加了管脚约束之后进行布局布线，然后报了这样的错误，E: Place-0084: GLOBAL_CLOCK: the driver key_mode_ibuf/opit_1 fixed at IOLHR_16_1296 is unreasonable. Sub-optimal placement for a clock source and a clock buffer.请问是为什么

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3个月前发布62次阅读

关于远程硬件200h测试引脚绑定的问题

想问一下大家
1.关于远程硬件测试的200H板卡的引脚需要去哪找，题目旁边的下载资料里也没有给相应的手册，我想用自己的PDS生成bit流烧进去看现象；
2.PDS里没有200H这个器件，该如何添加device？

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3个月前发布60次阅读

求助：为什么有了top.v文件了，flow中还是没有compile选项？-逻辑矩阵技术社区

已解决求助：为什么有了top.v文件了，flow中还是没有compile选项？

如图，没有compile，也无法综合呀

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3个月前发布60次阅读

求大佬帮忙看看哪里出问题了！

昨天还可以烧录调试的，今天中午就检测不到了，重新断电，关软件，上电，试了好多次都是这样，昨天好像烧录调试的过程中突然就显...

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