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FPGA
FPGA初学者园地
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为FPGA新手提供学习资源，包括语言基础、开发工具使用和简单实验，快速上手。
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精华
Eee111777
2个月前发布
21次阅读
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私信
时钟管脚约束
想问一下为什么盘古50K的差分时钟约束不了，无法设置成A10和B10，差分时钟该怎么约束
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用户99984988
2个月前发布
21次阅读
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私信
远程实验室
求问，远程实验室的fpga芯片是什么，pds创建的相关设置需要注意什么
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小眼睛FPGA
5个月前发布
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私信
【verilog每日一练】第十四练：寄存器“打一拍”
题目：请用verilog实现寄存器“打一拍”，将信号延时1个时钟周期，默认signal与clk信号同步，参考波形如下：
答案：
解析：“打...
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小眼睛FPGA
5个月前发布
20次阅读
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私信
【verilog每日一练】第三十练：repeat(n)@(posedge clk)和“#”控制仿真信号延时的区别
题目：请描述以下两种方法产生的信号有何区别
答案：
“#”是按仿真时间单位来控制rst_n信号的变化；repeat(n)@(posedge clk)是...
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yfl118
2个月前发布
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私信
求救
跑例程仿真遇到了成吨的报错，有uu知道为什么吗
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intelligente
2个月前发布
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私信
提问
100pro开发板 基于ADC硬核读取内部电压及温度
PG2L100H
请教各位，100pro开发板的例程4_7_adc_top，基于ADC 硬核读取内部电压及温度，读出来的温度输出码409F按照换算公式算出来是一千...
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greg
28天前发布
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私信
提问
远程升级中应用位流开关无效
按照Logos系列FPGA配置用户指南中的远程升级位流方式，芯片是PGL50G，如果人为将同步字擦除，重新上电后无法跳转到黄金位流，还...
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小眼睛FPGA
5个月前发布
19次阅读
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私信
【verilog每日一练】第一练：如何区分＜=表示的含义
题目：请描述以下两种方法产生的信号有何区别
答案：根据“<=”所在语句，在赋值语句中表示非阻塞赋值，在条件判断语句中表示...
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用户25638240
3个月前发布
19次阅读
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私信
配置200H网口
打开网络选择更改适配器选项
右建选择属性 然后到Internet协议版本四
点击属性进行如下配置
WIN+R 输入cmd 输入ARP –s 192.168....
+2
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Eee111777
2个月前发布
19次阅读
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私信
PDS报错
E: Place-0084: IO_CLOCK: the driver u_ddr3_test_h/u_ipsxb_ddrphy_pll_0/u_pll_e3/goppll fixed at PLL_158_179 is unreasonable. Sub-optimal placement for a clock source and a clock buffer.这个报错该怎么解决
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小眼睛FPGA
5个月前发布
18次阅读
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私信
【verilog每日一练】第九练：基本逻辑运算符的使用
题目：用组合逻辑实现以下运算
答案：assign L=（A&&B）||（!A&&B）；
解析：verilog常用操作符如下，需注意多...
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小眼睛FPGA
5个月前发布
18次阅读
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私信
【verilog每日一练】第二十七练：Testbench的仿真时间单位和仿真精度
题目：请用timescale定义仿真时间单位和仿真精度，并实现仿真开始前20ns的reset信号为1，20ns之后reset信号一直为0
答案：
解析...
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小眼睛FPGA
5个月前发布
18次阅读
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私信
【verilog每日一练】第二十八练：Testbench的时钟信号的产生
题目：请结合timescale定义和#的语法，生成周期为20ns的时钟信号clk
答案：
方法一：
方法二：
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Nill
8个月前发布
17次阅读
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私信
约束：IO组与时序约束的协同
约束
教材要求按教材讲解把 IO 分组与时序约束对应起来，提交实验报告时附上约束快照与时序收敛截图。
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小眼睛FPGA
5个月前更新
17次阅读
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私信
【verilog每日一练】第四练：位拼接符的使用
题目：请用位拼接符实现c[22:0]的表示，c的数值为：
答案：
解析： 位拼接运算符{ }用于将两个或多个信号拼接起来，中间用逗号...
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小眼睛FPGA
5个月前发布
17次阅读
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私信
【verilog每日一练】第二十五练：function的使用
题目：用function实现a，b，c三个输入数据取最大值
答案：
解析： function函数定义语法如下：
若需使用参考答案中的函数，参考...
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YYYY
3个月前发布
16次阅读
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私信
手把手教会在 FPGA 中的 DDS 调制：从代码看懂 AM 与 FM 的核心思想
大家好，很多FPGA初学者在学习DDS（直接数字频率合成）时，往往觉得“调制”是一个很复杂的概念。其实，它的核心思想非常朴素：...
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小眼睛FPGA
5个月前发布
15次阅读
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私信
【verilog每日一练】第二练：变量之间的三目运算练习
问题：设变量a，b，c，请用三目运算符实现：c的值为a和b两者较大的数值
答案：assign c=(a>b)?a:b;
解析：condition_expr?true_expr1:false_expr2;
condition_expr为逻辑真则结果为true_expr1，condition_expr为逻辑假则结果为false_expr2
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小眼睛FPGA
5个月前发布
15次阅读
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私信
【verilog每日一练】第六练：if_else语句基本用法
题目：请用if_else语句实现：c为a和b中的较大值
答案：
解析：if-else基本语法
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Az147139111
2个月前发布
15次阅读
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私信
求助！！！
本人第一次打集创赛，目前为止，没有任何思路与头绪，求各位大佬指点一下，我该如何入手
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