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【verilog每日一练】第十七练：reg型存储器应用（二维数组）
题目：用verilog将变量ram_in的数值赋值给ram的arraysize为1的单元
答案：
解析：arraysize表示深度，此处ram也可理解为32个...
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2个月前发布
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【verilog每日一练】第十六练：reg型存储器声明（二维数组）
题目：声明一个位宽为8，深度为32的二维数组变量ram
答案：reg [7:0]ram[31:0];解析：reg ［wordsize ： 0］ array_name ［arraysize ： 0］;wordsize表示位宽，arraysize表示深度
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【verilog每日一练】第十五练：识别信号边沿
题目：请用verilog实现signal信号上升沿的识别，每识别到上升沿将flag信号拉高1个时钟周期
答案：
解析：signal信号经过“打一拍...
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2个月前发布
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【verilog每日一练】第十四练：寄存器“打一拍”
题目：请用verilog实现寄存器“打一拍”，将信号延时1个时钟周期，默认signal与clk信号同步，参考波形如下：
答案：
解析：“打...
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【verilog每日一练】第十三练：计数器计时
题目：已知外部输入时钟信号clk为50MHz，请用verilog实现计数器的计时1秒钟，每间隔1秒输出一个clk时钟周期的脉冲信号flag，参考...
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【verilog每日一练】第十二练：变量位宽的选取
题目：定义一个reg型变量a，a的最大值为2000，则a的最小位宽需定义为多少
答案：reg [10:0]a;解析：在verilog中位宽指二进制数的位宽，十进制的2000转成二进制为：111 1101 0000，所以变量a最小位宽为11。通常在代码上会为变量再预留一部分位宽避免溢出，若数...
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【verilog每日一练】第十一练：二进制数值中1的个数奇偶判断
题目：用verilog实现变量flag为1表示变量a的数值中二进制1的个数是奇数，flag为0表示变量a的数值中二进制1的个数是偶数，比如：a...
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【verilog每日一练】第十练：移位操作符的使用
题目：定义变量reg [7:0]a;reg [7:0]b;reg [7:0]c;暂不考虑溢出及小数，用移位操作符（<<、>>）实现b等于a乘以4的结...
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【verilog每日一练】第九练：基本逻辑运算符的使用
题目：用组合逻辑实现以下运算
答案：assign L=（A&&B）||（!A&&B）；
解析：verilog常用操作符如下，需注意多...
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2个月前发布
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【verilog每日一练】第八练：if_else语句优先级
题目：利用if_else语句中多个条件的优先级关系实现：将变量a[5:0]的十进制中的十位对应的数字提取出来，并且将十位对应的数字赋...
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2个月前发布
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【verilog每日一练】第七练：if_else语句的嵌套用法
题目：请用if_else嵌套语句实现：d的值为a,b,c三个数取其中最大数值
答案：
解析：if语句和else语句均支持嵌套用法
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【verilog每日一练】第六练：if_else语句基本用法
题目：请用if_else语句实现：c为a和b中的较大值
答案：
解析：if-else基本语法
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【verilog每日一练】第五练：位拼接符的应用
题目：若1bit串行信号data_in按高位先发的顺序传输一个8bit的数据，data_en为使能信号，请用位拼接符实现串行数据的接收并输出接...
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【verilog每日一练】第四练：位拼接符的使用
题目：请用位拼接符实现c[22:0]的表示，c的数值为：
答案：
解析： 位拼接运算符{ }用于将两个或多个信号拼接起来，中间用逗号...
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【verilog每日一练】第三练：“inout” 双向端口类型的使用
题目：verilog除了input和output的端口类型，还有inout双向端口，比如在IIC协议中sda为双向信号。若sda在sda_out_en为1时输出sda...
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2个月前发布
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【verilog每日一练】第二练：变量之间的三目运算练习
问题：设变量a，b，c，请用三目运算符实现：c的值为a和b两者较大的数值
答案：assign c=(a>b)?a:b;
解析：condition_expr?true_expr1:false_expr2;
condition_expr为逻辑真则结果为true_expr1，condition_expr为逻辑假则结果为false_expr2
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2个月前发布
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【verilog每日一练】第一练：如何区分＜=表示的含义
题目：请描述以下两种方法产生的信号有何区别
答案：根据“<=”所在语句，在赋值语句中表示非阻塞赋值，在条件判断语句中表示...
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2个月前更新
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【两周学会FPGA】从0到1学习紫光同创FPGA开发|盘古PGL22G开发板学习之DDR3 IP简单读写测试（六）
本原创教程由深圳市小眼睛科技有限公司创作，版权归本公司所有，如需转载，需授权并注明出处
适用于板卡型号：
紫光同创PGL22G开...
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【两周学会FPGA】从0到1学习紫光同创FPGA开发|盘古PGL22G开发板学习之数码管动态显示（五）
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紫光同创PGL22G开...
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【两周学会FPGA】从0到1学习紫光同创FPGA开发|盘古PGL22G开发板学习之数码管静态显示（四）
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爪云
14小时前
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我是按例程改的。如果黑屏的话先看HDMI芯片配置有没有问题看那个绑的led灯。如果是黑白屏的话用debugger抓一下HDMI的输入。大概率是输入一直是0的原因。输入是0也是HDMI芯片出问题了。换别电脑做输入源试试，我的工程就我的电脑可以正常显示，给队友也显示不了，我也不知道什么原因
用户75618739
前天
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核心板的时钟复位引脚之类的资料有吗
用户46543417
前天
0
同学，请问你下载过了吗？有正常显示吗？
sean
2天前
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兄弟你是怎么调的，我也没调出来
王zihan
3天前
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现在还能进行那个技术测试吗
用户46543417
3天前
0
我现在重新录入了几遍程序，现在有现象了，但是HDMI显示屏是黑白竖线（分层的黑白竖线，明显有两条横线将实现分开，并分层），然后LED0闪烁，LED1，LED2，LED3常亮，请问这种情况正常吗？是因为不能直接连接电脑传输吗？还是因为什么其他的原因吗？求[图片]
用户46543417
3天前
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在给的资料里面的demo里面
用户56458290
3天前
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求问这个.v文件是在哪里可以获取啊
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爪云
14小时前0
我是按例程改的。如果黑屏的话先看HDMI芯片配置有没有问题看那个绑的led灯。如果是黑白屏的话用debugger抓一下HDMI的输入。大概率是输入一直是0的原因。输入是0也是HDMI芯片出问题了。换别电脑做输入源试试，我的工程就我的电脑可以正常显示，给队友也显示不了，我也不知道什么原因用户75618739 前天0
核心板的时钟复位引脚之类的资料有吗用户46543417 前天0
同学，请问你下载过了吗？有正常显示吗？sean
2天前0
兄弟你是怎么调的，我也没调出来王zihan 3天前0
现在还能进行那个技术测试吗用户46543417 3天前0
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在给的资料里面的demo里面用户56458290 3天前0
求问这个.v文件是在哪里可以获取啊