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等级-LV3-逻辑矩阵技术社区

9个月前发布16次阅读

约束实践：40pin 映射与命名规范

约束助教要求课堂验收时助教要求约束与原理图一致，并能一眼看出信号功能。我们统一命名与注释，减少沟通成本。NET ADC_IN0 LOC=PIN_1建议：把约束与 IO 表做成共享文档，组员协同更新。

电源与配件

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8个月前发布16次阅读

摄像头：PG2L100H帧率与带宽规划

PG2L100H 机房窗口期机房开放时间有限，我们先在低帧率跑通，再预约窗口做高帧率测试，逐步收集数据。

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等级-LV1-逻辑矩阵技术社区

3个月前更新16次阅读

用函数指针表替代大段 switch-case：嵌入式命令分发的常用技巧

嵌入式里经常要根据一个索引或命令码执行不同操作，最直觉的写法是 switch-case：
void handle_cmd(uint8_t cmd) { switch (cmd) { case CMD_START: do_start(); break; case CMD_STOP: do_stop(); break; case CMD_RESET: do_reset(); break; case CMD_STATU...

ARM基础入门

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3个月前发布16次阅读

手把手教会在 FPGA 中的 DDS 调制：从代码看懂 AM 与 FM 的核心思想

大家好，很多FPGA初学者在学习DDS（直接数字频率合成）时，往往觉得“调制”是一个很复杂的概念。其实，它的核心思想非常朴素：...

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8个月前发布15次阅读

显示：颜色空间转换的资源评估

颜色格式学生预算预算有限，优先用软件实现做验证，确认方案后再考虑硬件加速以满足展示要求。

电源与配件

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5个月前发布15次阅读

【verilog每日一练】第二练：变量之间的三目运算练习

问题：设变量a，b，c，请用三目运算符实现：c的值为a和b两者较大的数值
答案：assign c=(a>b)?a:b;
解析：condition_expr?true_expr1:false_expr2;
condition_expr为逻辑真则结果为true_expr1，condition_expr为逻辑假则结果为false_expr2

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5个月前发布15次阅读

【verilog每日一练】第六练：if_else语句基本用法

题目：请用if_else语句实现：c为a和b中的较大值
答案：
解析：if-else基本语法

【verilog每日一练】第六练：if_else语句基本用法-逻辑矩阵技术社区

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2个月前发布15次阅读

求助！！！

本人第一次打集创赛，目前为止，没有任何思路与头绪，求各位大佬指点一下，我该如何入手

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1个月前发布15次阅读

重偿求，用以太网怎么传输双目的摄像头模块！！！以及文档提模版！有偿！

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9个月前发布13次阅读

rtl8723du：固件升级与回退方案

rtl8723du 校园网场景图书馆 Wi-Fi 认证后偶发断连，升级驱动后反而更频繁。回退到旧版并关闭省电策略，稳定性恢复。建议：在校内环境，优先保证连接稳定，升级要留回退方案。

ARM基础入门

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9个月前发布13次阅读

脚本化：统一仿真流程与日志格式

脚本社团CI用社团服务器跑 GitLab CI，每晚定时回归仿真用例，第二天上课前在群里推送报告。效果：大家不用抢机房电脑，错误集中反馈。

SOPC项目实践

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5个月前发布13次阅读

【verilog每日一练】第五练：位拼接符的应用

题目：若1bit串行信号data_in按高位先发的顺序传输一个8bit的数据，data_en为使能信号，请用位拼接符实现串行数据的接收并输出接...

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5个月前发布13次阅读

【verilog每日一练】第七练：if_else语句的嵌套用法

题目：请用if_else嵌套语句实现：d的值为a,b,c三个数取其中最大数值
答案：
解析：if语句和else语句均支持嵌套用法

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5个月前发布13次阅读

【verilog每日一练】第十练：移位操作符的使用

题目：定义变量reg [7:0]a;reg [7:0]b;reg [7:0]c;暂不考虑溢出及小数，用移位操作符（<<、>>）实现b等于a乘以4的结...

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5个月前发布13次阅读

【verilog每日一练】第二十九练：testbench编写基本结构

题目：根据如下模块，编写对应的testbench文件
答案：
解析：testbench基本结构：1.仿真时间单位/时间精度 `timescale...

【verilog每日一练】第二十九练：testbench编写基本结构-逻辑矩阵技术社区

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8个月前发布12次阅读

摄像头：PG2L100H曝光与增益调节

PG2L100H 摄影社团请摄影社的同学帮忙在不同光照下拍样张，调整曝光与增益参数，观感更好。

硬件加速与算力

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5个月前发布12次阅读

【verilog每日一练】第十一练：二进制数值中1的个数奇偶判断

题目：用verilog实现变量flag为1表示变量a的数值中二进制1的个数是奇数，flag为0表示变量a的数值中二进制1的个数是偶数，比如：a...

【verilog每日一练】第十一练：二进制数值中1的个数奇偶判断-逻辑矩阵技术社区

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5个月前发布12次阅读

【verilog每日一练】第二十一练：parameter声明常量

题目：时钟频率是中代码计时计数器的重要参数，为提高代码的可读性及移植性，可通过一个参数定义时钟频率参数，请用parameter定...

【verilog每日一练】第二十一练：parameter声明常量-逻辑矩阵技术社区

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3个月前更新12次阅读

用宏生成代码：C 预处理器的 #、## 与 X-Macro

大多数人用宏只会 #define 替换，但预处理器还有两个操作符几乎没人注意到，用好了能省掉大量重复代码。
#：字符串化
在宏参数前加 #，把参数原样变成字符串字面量：
#define STRINGIFY(x) #x

ARM基础入门

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8个月前发布11次阅读

GTP：输入缓冲与抖动分析

GTP 课设体验我们用学校老旧板卡做实验，参考时钟质量一般。通过缩短走线与优化参考源，抖动明显改善。

传感器模块

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